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QHx220
SPI Bus Characteristics
T BEB2C
T C2BEB
CLK
T CL
T CH
T CP
BUSENBAR
24BIT
DATA
T DS
MSB
T DH
LSB
Data register lock
FIGURE 2. SPI BUS TIMING DIAGRAM
SPI BUS TIMING REQUIREMENT
SYMBOL
t CP
t CL
t CH
t BEB2C
t C2BEB
t DS
t DH
PARAMETER
SPI clock period
Clock pulse width low
Clock pulse width high
BUSENBAR Fall to CLK Rise Setup Time
CLK Rise BUSENBAR Fall Delay
Data Setup Time
Data Hold Time
MIN
100ns
40ns
40ns
5ns
40ns
20ns
0ns
TYP
MAX
TABLE 1. SPI BUS DATA FORMAT
10BIT I-DAC
<23:14>
10BIT Q-DAC
<13:4>
FREQ RANGE
<3:2>
GAIN
<1>
SPARE
<0>
5
FN6986.0
October 20, 2009
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